由于 Cerebras 的晶圆级引擎本身已经达到了单个晶圆二维物理剪裁面积的最大实用极限，业内普遍认为继续在水平方向上扩容面临物理天花板。为此，

　　CS‑6 的关键变化是引入 3D 堆叠 DRAM，将 DRAM 层通过超高带宽垂直互连直接置于逻辑 / SRAM 晶圆之上。

　　官方目标是“把更多模型权重和状态放在更靠近计算的位置”，在保持晶圆级低延迟数据流优势的同时，突破仅靠 SRAM 扩容的瓶颈。

　　Cerebras 表示，CS‑6 的设计可在不破坏数据局部性的前提下提升每系统可承载模型规模，从而减少运行超大模型所需的系统数量。

　　在空间利用率方面，Cerebras 首席执行官 Andrew Feldman 强调，得益于垂直 3D 堆叠对内部组件密度的极端压榨，CS-6 的整机系统足迹将实现 5 到 10 倍的量化递减。

　　在计算密度方面，减少 SRAM 面积占比可以释放出更多空间用于布置核心的算力硬件，从而在更小的芯片物理面积内塞入更多的计算逻辑。

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